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A camada fsica disponibiliza servios de transporte de dados para camadas superiores. O acesso a estes servios ocorre atravs do uso de canais de transporte da sub-camada MAC. A camada fsica executa as seguintes funes para a disponibilizar servios de transporte de dados: Modulao e espalhamento/deespalhamento, controle de potncia de loop fechado, etc.
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Referncias
l l l
TS 25.104 UTRA (BS) FDD Radio Transmission and Reception TS 25.201 Physical layer-general description TS 25.211 Physical channels and mapping of transport channels onto physical channels (FDD)
l l l l
TS 25.212 Multiplexing and channel coding (FDD) TS 25.213 Spreading and modulation (FDD) TS 25.214 Physical layer procedures (FDD) TS 25.308 UTRA High Speed Downlink Packet Access (HSDPA); Overall description; Stage 2 TR 25.877 High Speed Downlink Packet Acces (HSDPA) - Iub/Iur Protocol Aspects TR 25.858 Physical layer aspects of UTRA High Speed Downlink Packet Access
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de: [ Entender a arquitetura do protocolo da interface de rdio [ Entender tecnologias chaves da camada fsica do UMTS [ Entender os procedimentos de camada fsica UMTS
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Captulo 1 Viso geral da camada fsica Captulo 2 Tecnologias chave da camada fsica Captulo 3 Processamentos na camada fsica Captulo 4 Procedimentos da camada fsica
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controle
RLC
RLC
RLC
RLC
L2/RLC
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Tecnologia de Espalhamento
l O espalhamento consiste de 2 passos
[ A operao de canalizao transforma os smbolos de dados em chips. Este procedimento aumenta a largura de faixa do sinal. Quantos chips so multiplicados por cada bit o fator de espalhamento (Spreading Factor - SF. Esta operao executada pela multiplicao dos dados com cdigos OVSF. [ Operao de Scrambling aplicada ao sinal espalhado.
Data bit
OVSF code
Scrambling code
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Cdigos de canalizao
l
Cdigos OVSF so utilizados como cdigos de canalizao, mantendo a ortogonalidade entre os canais fsicos
l
Cdigos de Scrambling
l Cdigos de scrambling: seqncias GOLD. l Perodo do cdigo de Scrambling : 10ms ou 38400
chips.
l O cdigo utilizado para embaralhamento dos canais
DPCCH/DPDCH de uplink podem ser tanto do tipo curto quanto do tipo longo. Existem 224 cdigos de scrambling de uplink do tipo longo e outros 224 do tipo curto. Estes cdigos so designados por camadas superiores.
l Para canais fsicos de downlink, um total de 218-1 =
262,143 cdigos de scrambling podem ser gerados. Scrambling codes k = 0, 1, , 8191 so usados.
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Conjunto 1
Conjunto 511
512 sets
Grupo 63
Primary scrambling code 63*87 Cada grupo consiste de 8 cdigos de scrambling primrios
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scrambling primrio
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Captulo 1 Viso geral da camada fsica Captulo 2 Tecnologias chave da camada fsica Captulo 3 Processamentos na camada fsica Captulo 4 Procedimentos da camada fsica
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Captulo 2 Tecnologias chave da camada fsica Seo 1 Estrutura e funes da camada fsica Seo 2 Mapeamento de canais
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tipos: canais de controle e canais de servio. Estes canais definem o tipo de informao a ser transmitida.
disponibilizado para a camada MAC para a camada fsica. As informaes transportadas podem ser dedicadas a um usurio ou comum a todos os usurios. Podem ser divididos em canais dedicados e canais comuns. Estes canais definem como e com quais caractersticas a informao vai ser transmitida.
serem transmitidos na interface de radio. Cada tipo de canal que utiliza uma portadora de rdio, cdigo (espalhamento e scramble) e fase da portadora (I ou Q) podem ser considerados como canais dedicados. Estes canais implementam a transmisso da informao na interface area.
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Canais Lgicos
Dedicated traffic channel Common traffic channel DTCH CTCH Traffic channel
Broadcast control channel BCCH Paging control channel Dedicate control channel Common control channel PCCH DCCH (CCCH Control channel
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Canais de transporte
Dedicated Channel (DCH) Dedicated transport channel
Broadcast channel Forward access channel Paging channel Random access channel
Canais fsicos
l Um canal fsico definido por uma freqncia de portadora
Canal Fsico
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38400 chips
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[(Downlink DPCH)
l
[Common Control Physical Channel (CCPCH) [Synchronization Channel (SCH) [Paging Indicator Channel (PICH) [Acquisition Indicator Channel (AICH) [Common Pilot Channel (CPICH) [High-Speed Packet Downlink Shared Channel (HS-PDSCH) [High-Speed Shared Control Channel (HS-SCCH)
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[ Uplink Dedicated Physical Data Channel (Uplink DPDCH) [ Uplink Dedicated Physical Control Channel (Uplink DPCCH) [ High-Speed Dedicated Physical Channel (HS-DPCCH)
l Uplink Common Physical Channel
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Paging channels
S-CCPCH-Secondary S-CCPCH-Secondary common common control control physical physical channel channel PICH-paging PICH-paging Indicator Indicator Channel Channel
UE
Dedicated channels
DPDCH-dedicated DPDCH-dedicated physical physical data data channel channel DPCCH-dedicated DPCCH-dedicated physical physical control control channel channel
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Usado para pesquisa de clulas l SSC especifica o grupo do cdigo de scrambling da clula. l Dois sub-canais: P-SCH & S-SCH. l SSC escolhido de conjunto de 16 l SCH transmitido nos primeiros 256 cdigos diferentes de comprimento chips de cada time slot. 256. Ao todo so 64 grupos de cdigos de scrambling primrios. l P-SCH transmitido repetidamente em cada time slot.
Slot #0 Slot #1 Slot #14
ac p ac si,1
ac p acsi,14
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#0 1 1 1 1 1 9 9 9
#1 1 1 2 2 2 10 11 12
#2 2 5 1 3 16 13 12 10
#3 8 16 15 1 6 10 15 15
#4 9 7 5 8 6 11 12 13
#5 10 3 5 6 11 15 9 14
#9 16 10 11 8 1 12 14 11
Slot #?
Slot #?
acp 16
256 chips 2560 chips
acp 6
acp 11
Grupo 2 Slot 7, 8, 9
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[ Utiliza um cdigo fixo de canal--Cch, 256,0 (todos chips =1) [ Define o cdigo especifico dentro dos grupos de cdigos de scrambling primrio [ Existe somente um CPICH por clula [ Broadcast por toda a clula [ O P-CPICH uma referncia de fase para SCH, Primary CCPCH, AICH, PICH, downlink DPCH.
Seqncia de smbolos pr-definida
Tslot = 2560 chips , 20 bits
Slot #0
Slot #1
Slot #14
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256 chips SCH PCCPCH Data 18 bits T slot = 2560 chips,20 bits
Slot #0
Slot #1
Slot #14
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PICH um canal fsico com taxa fixa (SF=256) utilizado para o transporte de Paging Indicators (PI). PICH sempre associado com um S-CCPCH no qual um canal de transporte PCH mapeado. Estrutura de quadro PICHum quadro de comprimento 10ms consiste de 300 bits dos quais 288 bits so utilizados para o transporta indicadores de paging e os 12 remanescentes no foram definidos. N paging indicators {PI0, , PIN-1} em cada quadro PICH, N=18, 36, 72, ou 144. Exemplo: se N=72, 288/72=4 bits consecutivos/PI Se um paging indicator em um certo quadro 1, isto indica que UEs associados devem ler o quadro correspondente ao S-CCPCH associado.
l l l
12 bits (undefined)
b 287 b 288 b 299
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FACH e PCH.
l SF
=256 - 4.
tipos S-CCPCH: com ou sem TFCI. UTRAN decide se um TFCI deva ser transmitido.O UE deve suportar TFCI. taxas so as mesmas do DPCH de downlink resposta ao paging
l FACH
l Possveis l FACH
e PCH podem ser mapeados em um ou em separados S-CCPCHs. Se mapeado no mesmo S-CCPCH, podem ser mapeados no mesmo quadro necessrio quando os dois canais esto mapeados juntos
l TFCI
Slot #0
Slot #1
Slot #14
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[ Um ou vrios prembulos: cada prembulo possui um comprimento de 4096 chips e consiste de 256 repeties de uma assinatura de comprimento 16 chips. No total, 16 assinaturas so disponveis (16 OVSF codes of SF=16). [ Parte de mensagem com 10 ou 20ms [ Qual assinatura est disponvel e o comprimento da parte de mensagem, so determinadas por camadas superiores
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Preamble
Preamble
Message part
Preamble
Preamble
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radio frame: 10 ms
radio frame: 10 ms
5120 chips
#2
#3
#4
#5
#6
#7
#8
#9
#10
#11
#12
#13
#14
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Dados
Controle
Slot # 0 Slot # 1
Slot # 14
SF = 32, 64, 128 ou 256 para a parte de dados SF=256 para a parte de dados Piloto = 8 bits TFCI = 2 bits
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seqncia repetida de 15 AI consecutivos, com comprimento de 20 smbolos cada (5120 chips). Cada time slot consiste de duas partes : Acquisition-Indicator(AI) e uma parte com durao de 1024 chips sem transmisso para evitar overlaping devido ao atraso do canal.
l Acquisition-Indicator (AI) possui 16 tipos de assinatura. l CPICH a referncia de fase do AICH.
AI part
a0 a1 a2 a30 a31 a32 a33
Unused part
a38 a39
AS #14
AS #0
AS #1
AS #i 20 ms
AS #14
AS #0
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DPDCH
Data N databits Pilot Npilot bits TFCI NTFCI bits FBI NFBI bits TPC NTPC bits
DPCCH
Slot #0 Slot #1
Slot #14
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Slot #0
Slot #1
Slot #14
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transporte
l SF=16, pode ser configurado a vrios canais para aumentar os servios de
dados
D a ta N d ata 1 b its T slot = 2 56 0 ch ip s, M *1 0 *2
k
b its (k= 4 )
S lot # 0
S lo t# 1 1 s u b fra m e : T f = 2 m s
S lo t # 2
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esquema de modulao (1 bit), conjunto de cdigos de canalizao (7 bit), tamanho do bloco de transporte (6bit), nmero do processo HARQ (3bit), verso de redundncia (3bit), indicador de novos dados (1bit), identidade do UE (16bit)
l HS-SCCH possui taxa fixa (60 kbps, SF=128). um canal fsico
S lo t # 0
S lo t # 1 1 s u b f r a m e : Tf = 2 m s
S lo t # 2
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transporte de downlink e informaes de realimentao para o sistema para scheduling e adaptao do enlace dos blocos de transporte [ CQI e ACK/NACK
l Canal fsico , Uplink, SF=256, controle de potncia
T
s lo t
= 2 5 6 0 c h ip s
2T
s lo t
= 5 1 2 0 c h ip s CQI
H A R Q -A C K
O n e H S -D P C C H s u b fra m e (2 m s )
S u b fra m e # 0
S u b fra m e # i O n e ra d io fra m e T
f
S u b fra m e # 4
= 10 ms
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Captulo 2 Tecnologias chave da camada fsica Seo 1 Estrutura e funes da camada fsica Seo 2 Mapeamento de canais
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Captulo 1 Viso geral da camada fsica Captulo 2 Tecnologias chave da camada fsica Captulo 3 Processos na camada fsica Captulo 4 Procedimentos da camada fsica
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Captulo 3 Procedimentos na camada fsica Seo 1 Tcnicas de Codificao e Multiplexagem Seo 2 Tcnicas de Espalhamento Seo 3 Tcnicas de Modulao
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[ 08121624 (opcional)
inserido. Se TB so inseridos com TB SIZE=0, bits de CRC tambm devem ser inseridos, mas todos os bits de CRC so zero
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aplicados para TrCHs: [ Codificao convolucional, taxa de cdigos 1/3 e [ Codificao Turbo: a taxa 1/3 [ Nenhuma codificao
l Utilizao da codificao
[ BCHPCH e RACHc codificao convolucionai 1/2 [ DCH e FACH codificao convolucional ou 1/3, codificao Turbo 1/3, nenhuma codificao
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Adaptao de taxas
l Adaptao de taxas, significa que os bits nos canais de transporte
so repetidos ou puncionados.
l O volume de bits em um canal de transporte pode variar entre
diferentes intervalos de tempo de transmisso (TTI). Quando o nmero de bits entre diferentes intervalos de tempo de transmisso no uplink alterado, os bits so repetidos ou puncionados para assegurar que a taxa de bits total aps a multiplexagem no TrCH idntica taxa de bits do canal fsico dedicado.
l Este processo tem por objetivo fazer com que o Eb/No dos canais
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Interleaving
l Funo: reduzir a influncia do desvanecimento rpido reduzindo o
[ O 1o interleaving feito nos blocos de transporte aps a codificao de canal. A matriz pode conter 1, 2, 4 ou 8 colunas dependendo do TTI (Transmission Time Interval 10ms, 20ms, 40ms ou 80ms)
[ O 2 interleaving executado nos blocos de canais fsicos. A matriz tem 30 colunas e o nmero de linhas depende da quantidade de bits de informao. Se este nmero no for mltiplo de 30, dummy bits sero adicionados.
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ms, a seqncia de bits de entrada segmentada e mapeada em quadros de rdio (Fi) consecutivos.
l H equalizao no tamanho dos quadros de dados no UL de
forma a garantir o tamanho da seqncia de bits de entrada sendo um mltiplo inteiro de Fi.
l Na adequao de taxas no DL a seqncia de bits de entrada
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Multiplexagem do TrCH
l A cada 10 ms, um quadro de radio de cada TrCH entregue
multiplexagem de TrCH. Estes quadros de radio so multiplexados serialmente em um coded composite transport channel (CCTrCH)
l O formato do CCTrCH indicado por TFCI l TrCH podem possuir TTI diferentes antes da multiplexagem l 2 tipos de CCTrCH: Comuns e dedicados
[ Common CCTrCH devem ser multiplexados por TrCH comuns; [ Dedicated CCTrCH: devem ser multiplexados por TrCH dedicados
l Existe somente um CCTrCH no uplink e um ou vrios
[ Usados apenas quando as posies dos TrCHs nos quadros de radio so fixas.
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CCTrCH pode ser dividido em mltiplos quadros fsicos transmisso por mltiplos cdigos
l Cada canal fsico de transmisso por mltiplos cdigos devem possuir
o mesmo SF
l DPCCH e DPDCH dos canais fsicos de uplink so multiplexados por
cdigos.
l DPCCH e DPDCH dos canais fsicos de downlink so multiplexados
no tempo
l O canal fsico de uplink deve ser completamente preenchido quando o
com bits para serem transmitidos na interface area. Valores correspondentes aos indicadores DTX, que so mapeados nos campos DPCCH/DPDCH mas no so transmitidos atravs da interface area.
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TrCH-i+1
data
data
data
0816 or 24bits
data CRC
CRC CBL data
Size Z
Channel Coding
DTX
10ms 10ms
Ph-1
data1 TPC TFCI data2
Spreading Scrambling
Ph-2
data1 TPC TFCI data2
Spreading Scrambling
Ph-P
pilot
pilot
pilot
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TrC h # 2
103
TrC h # 3
60
Ta il b it a tta c h m e n t
81
12 Ta il
103 Ta il 103 8
60 Ta il 60 8
C o n v o lu tio n a l c o d in g R = 1 /3 , 1 /2 R a te m a tc h in g
93
303
333
136
1 st in te rle a v in g
3 0 3 + N RM 1
3 3 3 + N RM 2
1 3 6 + N RM 3
R a d io fra m e se g m e n ta tio n
3 0 3 + N RM 1
3 3 3 + N RM 2
1 3 6 + N RM 3
#1a
N R F1
#1b
N R F1
#2a
N RF2
#2b
N RF2
#3a
N R F3
#3b
N R F3
To T rC h M u ltip le x in g
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C R C
148 1 6 b its
T rB k c o n c a tin a tio n
B T r B k s (B = 0 ,1 )
T a il b it a tta c h m e n t
164*B
516*B
(5 1 6 + N
RM
)* B
st
in te rle a v in g
(5 1 6 + N
R M
)* B + N
D I
R a d io fra m e s e g m e n ta tio n #1
[ (1 2 9 + N
R M
(5 1 6 + N
RM
)* B + N
D I
#2
D I]
#3
D I]
#4
D I]
)* B + N
[ (1 2 9 + N
R M
)* B + N
[ (1 2 9 + N
R M
)* B + N
[ (1 2 9 + N
R M
)* B + N
D I]
T o T r C h M u ltip le x in g
* I n s e r tio n o f D T X in d ic a tio n is u s e d o n ly if th e p o s itio n o f th e T rC H s in th e r a d io f r a m e is fix e d .
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TrCH m ultiplexing
#1a #1b #1c #1 #2a #2b #2c #2 #1a #1b #1c #3 #2a #2b #2c #4
2nd interleaving
510 1 2 15 1 2 510 15 1 2 510 15 1 2 510 15
30 ksps DPCH
slot
CFN=4N
slot
CFN=4N+1
slot
CFN=4N+2
slot
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Captulo 3 Procedimentos na camada fsica Seo 1 Tcnicas de Codificao e Multiplexagem Seo 2 Tcnicas de Espalhamento Seo 3 Tcnicas de Modulao
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c DPDCH
3
d,3
c DPDCH
5
d,5
S I+jQ c
d,2
long,n
or S
short,n
DPDCH
c DPDCH
4
d,4
c DPDCH
6
d,6
90o
c DPCCH
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DPDCH/DPCCH
cd
d Sr-msg,n I I+jQ Q
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Espalhamento de Downlink
l Os canais fsicos de downlink, exceto SCH so primeiramente
convertidos de serial para paralelo, espalhados pelo cdigo de espalhamento e ento embaralhados por um cdigo de scrambling complexo.
l O chip de incio do cdigo de scrambling alinhado com os limites de
quadro do P-CCPCH.
l Cada canal possui diferentes fatores de ganho
I
Dados dos canais fsicos Exceto SCH
S P
Sdl,n
C ch,SF,m Q I+jQ
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Espalhamento de Downlink
G1
P-SCH GP Gn S-SCH GS
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Captulo 3 Procedimentos na camada fsica Seo 1 Tcnicas de Codificao e Multiplexagem Seo 2 Tcnicas de Espalhamento Seo 3 Tcnicas de Modulao
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Modulao de Uplink
l Taxa de chips = 3.84Mbps l No uplink, a seqncia de chips com valor complexo gerada no processo
t) cos(
Split real & imag parts
Re{S}
Pulse shaping
Im{S}
Pulse shaping
t) -sin(
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Modulao de Downlink
l Taxa de chip = 3.84Mbps l No downlink, a seqncia de chips com valor complexo gerada
cos(t)
Split real & imag parts
Re{S}
Pulse shaping
Im{S}
Pulse shaping
-sin(t)
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Captulo 1 Viso geral da camada fsica Captulo 2 Tecnologias chave da camada fsica Captulo 3 Processamentos na camada fsica Captulo 4 Procedimentos da camada fsica
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Slot synchronization
UE utiliza SSC para encontrar sincronizao de quadro e identificar o grupo de cdigos da clula encontrado no primeiro passo
Scrambling-code identification
UE determina o cdigo de scrambling pela correlao de todo o CPICH com todos os cdigos dentro do grupo identificado, e ento detecta o PCCPCH e l as informaes BCH
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k:th S -CCPCH
#9
#10
#11
#12
#13
#14
DPCH,n
n:th DPCH
10 ms
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START
No AI
Send a preamble
Choose a signature and increase preamble transmit power The counter of preamble retransmit Subtract-1, Commanded preamble power increased by Power Ramp Step Y Counter> 0 & Preamble powermaximum allowed power<6 dB N Set physical status to be Nack on AICH received
Send the corresponding message part Set physical status to be RACH message transmitted
END
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[ 1. Derivar os intervalos para acesso de uplink disponveis no prximo conjunto de intervalos de acesso completo, para o conjunto de sub-canais RACH disponveis dentro do mesmo ASC. Selecionar aleatoriamente um slot de acesso dentre os previamente determinados. Se no existir nenhum slot disponvel no conjunto selecionado, aleatoriamente seleciona um slot de acesso uplink correspondente ao conjunto de sub-canais RACH disponveis dentro de um ASC dado no prximo conjunto de slots de acesso. A funo randmica deve ser tal que cada uma das selees permitidas escolhida com igual probabilidade [ 2. Aleatoriamente selecionar uma assinatura do conjunto de assinaturas disponveis dentro de um dado ASC; [ 3. Ajustar o Preamble Retransmission Counter para Preamble_ Retrans_ Max
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[ 8. Se uma indicao de aquisio positiva correspondente assinatura selecionada detectada, transmitir a mensagem de acesso aleatria em trs ou quatro slots de acesso de uplink aps o slot de acesso de uplink do ltimo prembulo transmitido
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Modo de loop aberto TSTD STTD applied applied applied applied applied applied applied
applied
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antenas (STTD [ 4 bits consecutivos b0, b1, b2, b3 utilizando codificao STTD
b0 b1 b2 b3 b0 b1 b2 b3
Antena 1
-b 2 b 3 b 0 -b 1 Antena 2 Bits do canal Bits de canal codificados STTD Para antena 1 e antena 2.
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Slot #0
Slot #1
Slot #2
Slot #14
ac p
Antena 1
(Tx OFF)
acp acs
i,2
ac p acs
i,14
ac s
i,0
(Tx OFF)
(Tx OFF)
acp
i,1 acs
(Tx OFF)
(Tx OFF)
Antena 2
(Tx OFF) (Tx OFF) (Tx OFF)
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[ Usado no DPCH e PDSCH [ Codificao de canal, intercalao e espalhamento so executados como no modo sem diversidade. O sinal do espalhamento complexo alimentado a ambos os ramos de antenas de transmisso e compensados com fatores especficos w1 e w2. [ Os fatores de peso so determinados pelo UE, e assinalados ao ponto de acesso UTRAN (=cell transceiver) utilizando os bits D do campo FBI do DPCCH uplink . [ O clculo dos fatores o ponto chave da transmisso de diversidade de loop fechado. Existem dois modos com diferentes modos de clculo modo 1 utiliza ajustes de faseos smbolos do piloto dedicado de duas antenas so diferentes (ortogonais) modo 2 utiliza ajustes de fase/amplitude os smbolos do piloto dedicado das duas antenas so as mesmas.
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