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Eq.St 1
Fg.St 1
Captulo
Tt.St 1
Rf.St 0
fS 2
Filtro
antialiasing
H (z)
y*
N
fd 2
Filtro digital
D/A
Decimador
Modulador
Figura 1.1: Diagrama de bloques de un convertidor A/D .
Conceptos bsicos
x(t)
X ( f ) filtro antialiasing
espreos
x a ( t ) , xsh ( t )
Filtro
fb
Antialiasing
xa ( t )
...
fS
fS 2
fS
...
fb
S/H
x s h( t )
y ( n)
error de cuantizacin
con noise-shaping
iz
ac
i
Y ( f)
...
n
Q
ua
nt
Modulador
fS 2
X sh ( f )
y(n)
fb
fS 2
fS
yf(n)
Yf( f )
Filtro
filtro digital
Digital
...
...
n
fb
fS 2
fS
yf(n)
D
ec
im
ac
i
n
y d( n )
Yd ( f )
...
y d ( n)
...
n
...
fb
fS
(1.1)
Conceptos bsicos
y
y
i
imin
im a x
(a)
(b)
e
e
2
imin
i max
i
i
2(e)
1 1
SE ( f ) = -------------- = ---- --fS
fS
e 2 de
2
= ---------12f S
(1.2)
PQ =
fd 2
2
2 f
S E ( f ) df = ------ ---d- = ----------12M
12 f S
(1.3)
Un cuantizador precedido de un bloque donde se muestrea la seal a una frecuencia mucho mayor que su frecuencia de Nyquist constituye la base del convertidor de
sobremuestreo ms simple. Consideremos ahora un bloque que realiza la cuantizacin de manera mucho ms eficiente: el modulador .
La Fig. 1.4 muestra el esquema bsico de un modulador . En l se muestrea la
seal de entrada, x , a una frecuencia superior a la frecuencia de Nyquist y se le resta
Conceptos bsicos
la salida del cuantizador, y . Esta diferencia, tras pasar por un filtro de tiempo discreto con funcin de transferencia H ( z ) , sirve como entrada al propio cuantizador,
que tiene usualmente un reducido nmero de niveles. Si la ganancia de este filtro es
muy alta en intervalo de frecuencias de inters y baja fuera de l, el error de cuantizacin (diferencia entre la salida del filtro y la salida del cuantizador) es atenuado en
dicha banda por el lazo de realimentacin.
Para calcular el error de cuantizacin en moduladores han de tenerse en
cuenta las siguientes consideraciones:
(a) En los moduladores , al igual que en un cuantizador, el error de cuantizacin
queda completamente especificado por la seal de entrada.
(b) El nmero de niveles en el cuantizador es reducido. De hecho las arquitecturas
ms usadas de moduladores incorporan utilizan un simple comparador para
realizar la cuantizacin interna.
(c) Ante seales estticas, la entrada del cuantizador vara de muestra a muestra en
mltiplos o submltiplos de la separacin entre niveles de ste, .
Estos factores hacen que la aproximacin de considerar el error de cuantizacin
como ruido blanco descorrelacionado con la entrada (y por tanto uniformemente distribuido en el rango [ 2, 2 ] ) resulte controvertida. Sin embargo, cuando la
entrada al modulador vara en el tiempo, el estudio basado en suponer el error introducido por el cuantizador como ruido blanco conduce fcilmente a resultados cuya
validez se ha confirmado mediante desarrollos tericos complejos derivados de la
introduccin de correlacin entre la entrada y la salida del modulador [Gray90].
As pues, consideraremos, para el cuantizador, el modelo de la Fig. 1.4(b) donde
e ( t ) presenta una distribucin uniforme entre sus valores mximo 2 y mnimo
H ( z)
e(t)
N bits
i (t )
gq
y(t)
D/A
(a)
(b)
Figura 1.4: (a) Estructura bsica del modulador . (b) Modelo del cuantizador.
constante y viene dada por (1.2). Ntese que la ganancia que precede a la operacin
de cuantizacin en la Fig. 1.4(b) slo tiene sentido cuando el numero de niveles del
cuantizador sea superior a dos. Cuando se disponga nicamente de dos niveles, cual
es el caso de un comparador, el factor de ganacia es arbitrario pues, la salida del
comparador slo es funcin del signo de su entrada. De nuevo en este caso, la linearizacin del comparador supone una aproximacin grosera, pero que da lugar a
resultados aceptables a la vez que matemticamente simples.
Con ello el modulador de la Fig. 1.4(a) se convierte en un sistema de dos entradas x ( t ) y e ( t ) , y una salida y ( t ) que, en el dominio Z, puede representarse por
Y ( z ) = S T F ( z )X ( z) + NTF ( z )E ( z )
(1.4)
para
z1
(1.5)
esto es, el ruido de cuantizacin debe atenuarse en la zona de bajas frecuencias sin
que se distorsione la seal.
Analizando el esquema de la Fig. 1.4(a), la salida en el dominio Z resulta
H (z )
1
Y ( z ) = --------------------- X ( z) + --------------------- E ( z )
1 + H ( z)
1 + H (z )
(1.6)
(1.7)
El bloque ms sencillo que presenta una funcin de transferencia con esta caracterstica es un integrador, cuya funcin de transferencia en el dominio Z es,
Conceptos bsicos
z 1
H ( z ) = ---------------1 z 1
(1.8)
luego basta sustituir el filtro H ( z ) en la Fig. 1.4(a) por un integrador en tiempo discreto, Fig. 1.7, para obtener a la salida del modulador,
Y ( z ) = z 1 X ( z ) + ( 1 z 1 )E ( z )
(1.9)
esto es, una representacin digital de la entrada retrasada ms el ruido de cuantizacin afectado por una funcin de conformacin. En el dominio temporal, el ruido de
cuantizacin sufre una diferenciacin de forma que a cada muestra se le resta la
obtenida en el ciclo inmediatamente anterior. Intuitivamente se entiende, por tanto,
la reduccin del ruido en la zona de bajas frecuencias pues es all donde la variacin
muestra a muestra de ste es menor. Ntese que la funcin de transferencia del ruido
de cuantizacin, NTF ( z ) = ( 1 z 1 ) , es de primer orden. Por esta razn se conoce
al modulador de la Fig. 1.7 como modulador de primer orden 1. La nica diferencia entre el modulador de la Fig. 1.7 y su representacin conceptual en la
Fig. 1.4(a) es la inclusin de dos factores de amplificacin g 1 y g1 ' para la seal de
entrada y de realimentacin, respectivamente, comnmente llamados pesos o ganancias del integrador.
En el domino de la frecuencia la densidad espectral del ruido de cuantizacin
conformado resulta
f 2
f
S Q ( f ) = S E ( f ) 1 exp j 2 ---- = S E ( f ) 4 sin 2 ----
f
f
S
g1
E
I
g '
1
D/A
(1.10)
10
fd 2
PQ =
fd 2
2 2
S Q ( f ) df ------ ----------12 3M 3
fS
M = ---- 1
fd
(1.11)
Es til introducir en este punto las definiciones de algunas figuras de mrito que
caracterizan a los convertidores de sobremuestreo, y que sern usadas con profusin
en esta Tesis.
1. Relacin seal ruido (SNR S/N)
Es la relacin entre la potencia de salida a la frecuencia de una entrada sinusoidal
y la potencia en banda de ruido total. Se expresa normalmente en decibelios. Idealmente; esto es, teniendo en cuenta nicamente el ruido de cuantizacin, el SNR, que
es funcin de la amplitud de la entrada al modulador, A , se calcula como
A2 2
S N R ( dB ) = 10log 10 -------------
P
(1.12)
Conceptos bsicos
11
(1.13)
(1.14)
(1.15)
(1.16)
12
Potencia en (1.11)
-60
-65
-70
-1 -0.8 -0.6 -0.4 -0.2 0 0.2 0.4 0.6 0.8 1
Nivel de DC de la entrada referido a /2
13
dores sobrepasa las intenciones de esta Tesis. A continuacin se relacionan las arquitecturas de moduladores ms utilizadas prestando especial inters a aquellas cuyo
diseo se abordar en los Captulos sucesivos.
1.3.1 Modulador de segundo orden
14
g1
I1
g2
g '
2
g 1'
E
I2
D/A
(1.17)
(1.18)
PQ =
fd 2
2 4
S Q ( f ) df ------ ----------12 5M 5
fS
M = ---- 1
fd
(1.19)
15
10-1
N TF ( z ) 2
10-5
Primer orden
10-9
10-13
Segundo orden
10-17
10-21 -6
10
10-5
10-4
10-3
f fS
10-2
10-1
100
Potencia en (1.19)
-90
-1 -0.8 -0.6 -0.4 -0.2 0 0.2 0.4 0.6 0.8 1
Nivel de DC referido a /2
16
(1.20)
f
f
S
(1.21)
PQ =
fd 2
2
2L
S Q ( f ) df ------ -------------------------------------------12 ( 2 L + 1 )M ( 2L + 1 )
fS
M = ---- 1
fd
(1.22)
g1
g '
1
I1
g2
g '
2
I2
gL
E
Y
IL
g L'
D/A
17
18
Aparte de la arquitectura de la Fig. 1.10, existen otras posibilidades para conseguir funciones de conformacin de alto orden [Ribn91]. Algunas de estas se presentan a continuacin.
1.3.3.1 Moduladores de lazo nico
1. Una arquitectura similar pero usando cuantizadores multi-bit fue propuesta por Carley [Carl87].
19
BL
..
.
B2
B1
AL
..
.
A2
A1
A0
D/A
Ai(z 1)N i
i=0
S T F ( z ) = --------------------------------------------------------------------------------------------------------------------------L
z (z 1)L
Bi(z 1)L i +
i=1
(1.23)
Ai ( z 1 ) L i
i=0
L
(z 1)L
B i ( z 1 )L i
i =1
NTF ( z ) = --------------------------------------------------------------------------------------------------------------------------L
z (z 1)L
i =1
B i ( z 1 )L i +
(1.24)
A i ( z 1 )L i
i =0
Si todos los coeficientes B i son nulos, se obtiene una funcin NTF ( z ) con todos
los ceros localizados en DC. La funcin paso de alta es pues similar a la que se
obtiene con un filtro Butherworth o Chebychev. Si por el contrario se ajustan los
valores de los coeficientes B i para emplazar ceros en el rechazo de banda se consigue maximizar la selectividad del filtro paso de alta, y por consiguiente minimizar
el ruido de cuantizacin en la banda, con caractersticas similares a los filtros Chebychev inverso o elptico.
20
Una alternativa a los moduladores de lazo nico e interpolativos son las arquitecturas en cascada (multietapa o MASH) [Chou89][Long88][Mats87][Rebe90] cuyo
diagrama de bloques genrico se muestra en la Fig. 1.12. Su funcionamiento se basa
en la conexin en cascada de moduladores de bajo orden (0, 1 y 2), cuya estabilidad
est garantizada por diseo. El ruido de cuantizacin generado en una etapa es
remodulado por la/s siguiente/s y posteriormente cancelado en el dominio digital.
Como resultado, en el caso ideal, se obtiene la entrada ms el ruido de cuantizacin
de la ltima etapa atenuado por una funcin de conformacin de orden igual al
nmero total de integradores en todas las etapas.
Consideremos, a modo de ejemplo, el modulador de la Fig. 1.13. Esta arquitectura [Yin93b] es una posible realizacin de un modulador de cuarto orden en casE1
Y1
L1
E2
X2
Y2
L2
X3
EN
XN
LOGICA DE CANCELACION
YN
LN
g1
I1
g '
1
E1
g2
I2
Lgica de cancelacin
Y1
g '
2
21
H1 (z)
D/A
g
3
g 3'
g ''
3
I3
E2
d0
Y2
d1
H 2 (z )
D/A
g4
g '
4
g ''
4
H3 ( z )
E3
d2
I4
Y3
d3
D/A
H 4 (z )
cada con la estructura 2-1-1; esto es, una primera etapa de segundo orden seguida por
dos de primer orden. Su salida en el dominio Z puede representarse por
Y ( z ) = S T F ( z )X ( z ) + NTF 1 ( z )E 1 ( z ) + N T F2 ( z )E 2 ( z ) + N T F3 ( z )E 3 ( z )
(1.25)
(1.26)
NTF 3 ( z ) ( 1 z 1 ) 4
las cuales se traducen en las relaciones entre coeficientes y valores de los funciones
digitales H i( z) que se muestran en la Tabla 1.1.
22
Analgico
Digital/Analgico
Digital
g 1' = g 1
d 0 = 1 g3 ' ( g1 g 2 g 3 )
H1 ( z ) = z 1
g2 ' = 2g 1'g2
d 1 = g 3'' ( g1 g 2 g 3 )
H 2 ( z ) = ( 1 z 1 )2
g 4 ' = g 3'' g 4
g 3'
d 2 = 1 ----------------- 1
g
g g
1 2 3
g4 '
------------- 0
g3 ''g 4
d 3 = g4 '' ( g 1 g2 g 3 g 4 )
H3 ( z ) = z 1
H 4 ( z ) = ( 1 z 1 )3
(1.27)
23
24
25
Alto orden
en cascada
Ventajas:
Ventajas:
Ventajas:
- Mximo rango
de entrada til
- Mejores
patrones
ruido
- Estabilidad
garantizada.
Inconvenientes:
Inconvenientes:
- Estabilidad
- Circuitera simple
- Necesidad
alto M
de
- Patrones
ruido
de
de
- Estabilidad
condicionada
- Rango til inferior al rango de
entrada
completo.
Multi-bit
estabil-
- Mximo rango
de entrada til
- Mejores
patrones
ruido
Inconvenientes:
- Inconvenientes:
- Sensibilidad a la
circuitera.
- Circuitera
analgica y digital ms compleja
- Necesidad
de
ganancias
de
integradores
de
- Sensibilidad a
la no linealidad
Bits
DOR
(kS/s)
Arquitectura
[Bert93]
21
DC
2m CMOS / 5V
[Bran91a]
16
50
13.8
1m CMOS /5V
2o Orden
26
Bits
DOR
(kS/s)
Arquitectura
[Gril96]
15.3
2 o Orden
[Pelu96]
12
0.1
2 o Orden
[Send97]
14.3
20
0.55
[Tan95a]
11
20
SI, 2o Orden
[Tan95b]
10
15.6
0.78
SI, 2o Orden
[Nys96]
19
0.8
1.35
2 m CMOS / 5V
2o Orden, 3bits
[Saue95]
12
32
3 er Orden
[Au97]
11.8
15.6
0.34
[Kert94]
20
0.8
50
3 m CMOS / 10V
4 o Orden
[Zwan97]
15.7
40
2.3
gm-C, 4o Orden
[Bair96]
13.7
500
58
1.2m CMOS / 5V
4o Orden, 4bits
[Thom94]
20
0.984
45
2 m CMOS / 10V
5o Orden (tri-level)
[Mino95]
11
200
94
0.8m CMOS / 3V
7o Orden, Feedforward
[Leun97]
19.3
44
760
0.8m CMOS / 5V
[Yin93a]
15.7
320
65
1.2m CMOS / 5V
Cascada 2-1
[Will94]
17
50
47
1m CMOS /5V
Cascada 2-1
[Rabi96]
15
50
5.4
Cascada 2-1
[Bran91b]
12
2100
41
1m CMOS / 5V
[Yin94]
15.8
1500
180
2m BiCMOS / 5V
Cascada 2-1-1
[Fuji97]
18
48
500
0.7m CMOS / 5V
[Dedi94]
14.7
200
40
[Mats94]
9.4
384
1.56
0.5m CMOS / 1V
RC, swing-suppression
Adems, con excepcin del modulador en [Yin94], todos los procesos de fabricacin son CMOS. La tabla refleja tambin la tendencia actual de la reduccin de las
tensiones de polarizacin hasta 2V e inferiores [Au97][Gril96][Mats94][Pelu96]
27
[Saue95][Send97][Rabi96][Tan95b].
La Fig. 1.15 sita los convertidores de la Tabla 1.2 en el plano resolucin-frecuencia, Fig. 1.15(a), y en el plano consumo-frecuencia, Fig. 1.15(b). Por completitud se han aadido convertidores A/D a la frecuencia de Nyquist (esto es,
moduladores que no emplean sobremuestreo) implementados con arquitecturas
flash, pipelined, aproximaciones sucesivas, etc. Estos convertidores se recogen en la
Tabla 1.3.
Tabla 1.3: Resumen de otros convertidores A/D de alta frecuencia reportados
recientemente.
Ref.
Bits
DOR
(ks/s)
[Hamm97]
9.1
200
12
[Shu95]
11
10000
360
[Song95]
8.7
20000
50
1.2m CMOS / 5V
Pipelined
[Wu95]
8.2
4500
128
0.8m CMOS / 5V
SI, Pipelined
[Mant96]
9.4
300
5.4
Interleaved pipelined
[Ahm96]
10
10000
250
0.8m CMOS / 5V
Pipelined
[Lim96]
11
10000
250
0.8m CMOS / 5V
Pipelined
[Clin96]
13
5000
166
1.2m CMOS / 5V
Pipelined
[Yu96]
11
5000
33
Pipelined
[Kwak97]
14.1
5000
60
1.4m CMOS / 5V
Pipelined
[Ito94]
20000
135
0.8m CMOS / 3V
Subranging
[Yots95]
20000
20
0.5m CMOS / 2V
Mixed-mode subranging
[Vene96]
7.1
80000
80
Folding
[Bult97]
8.7
48000
170
0.5m CMOS / 5V
Flash + Folding
[Spal96]
200000
400
0.6m CMOS / 5V
Flash
1m CMOS / 5V
Arquitectura
Aproximaciones sucesivas
28
29
22
20
18
16
(BiCMOS)
14
12
(BiCMOS)
(baja tensin)
(modo intensidad)
Nyquist
Nyquist (baja tensin)
10
8
6
(a)
102
103
104
105
106
107
Razon de salida digital (muestras/s.)
108
109
102
103
104
105
106
107
Razon de salida digital (muestras/s.)
10 8
109
10-1
10-2
10-3
10-4
10-5
10-6
10-7
10-8
(b) 10-9
Figura 1.15: (a) Resolucin efectiva frente a razn de salida digital (DOR). (b)
Consumo de potencia normalizado al numero de niveles de la cuantizacin, segn la resolucin equivalente, en funcin del DOR.
30
La Fig. 1.15(b) muestra el consumo de potencia normalizado al nmero de niveles que tendra un cuantizador con el mismo nmero de bits equivalentes ( 2 bits ), el
cual, en promedio, crece con la frecuencia de Nyquist del convertidor
[Malo95][Nys93]. Ntese que los moduladores SI disipan mayor potencia normalizada que los moduladores SC en el mismo rango de frecuencias. Por otro lado, el
consumo de potencia resulta menor en los moduladores con baja tensin de polarizacin, los cuales se concentran en el rango de audio: aunque en general presentan
menor resolucin que sus equivalentes a 5V (Fig. 1.15(a)), la reduccin de las tensiones de polarizacin y el empleo de circuitos especficos para baja potencia
[Rodr95] permiten reducir significativamente el consumo.
1.4.1 Evaluacin comparativa de los moduladores reportados
(1.28)
donde resolucin es la resolucin efectiva del modulador y DOR es su razn de salida digital, que coincide con el doble del ancho de banda de la seal f d . El resultado
(en picojulios) es la energa necesaria por conversin. La potencia en (1.28) es el
consumo de potencia del modulador. En la mayora de los trabajos reportados no se
implementa la parte digital del modulador, de modo que no hay apenas datos sobre el
consumo de potencia del filtro digital que acompaa al modulador en un convertidor
completo. Una estimacin de tal consumo de potencia resulta compleja: si bien es
cierto que la cantidad de circuitera digital necesaria en un modulador de alto orden
y/o multibit es mayor que en una arquitectura ms sencilla, tambin lo es que aquellos requieren menor frecuencia de muestreo para obtener las mismas especificaciones. Ambos efectos pueden, groso modo, compensarse, de manera que es posible
evaluar comparativamente arquitecturas de moduladores dispares sin considerar el
consumo de potencia del filtro digital1.
El objetivo de reduccin del consumo de potencia se traduce en la minimizacin
del FOM. A modo de referencia, la Tabla 1.4 muestra el subconjunto de los prototi1. Sin embargo el consumo de la parte digital debe tenerse en cuenta para comparar realsticamente convertidores AD y convertidores A/D a la frecuencia de Nyquist [Good96].
31
pos en la Tabla 1.2 con un FOM menor que 10pJ, ordenados segn el valor de ste.
Ntese que el menor valor del FOM reportado hasta ahora es 1.4pJ y corresponde a
una arquitectura de segundo orden alimentada con 1.5V en el rango de audio
[Send97]. A ms alta frecuencia, el mejor FOM es 2.1pJ reportado por [Yin94] para
un modulador en cascada 2-1-1 implementado en una tecnologa BiCMOS. En tecnologa CMOS, los mismos autores reportan un modulador en cascada 2-1 para
320kS/s con un FOM de 3.9pJ [Yin93a]. El modulador con mayor DOR de la
Tabla 1.4 (2.1MS/s) [Bran91b] utiliza una arquitectura en cascada con cuantizacin
multibit y obtiene un FOM de 4.8pJ.
Tabla 1.4: Resumen de los moduladores con FOM<10.
Referencia
Resolucin
(bits)
DOR
(kS/s)
Consumo
(mW)
Tecnologa
Arquitectura
FOM
(pJ)
[Send97]
14.3
20
0.55
2o Orden
1.4
[Zwan97]
16.5
40
2.3
gm-C, 4o Orden
1.8
[Yin94]
15.8
1500
180
2m BiCMOS / 5V
Cascada 2-1-1
2.1
[Nys96]
19
0.8
1.35 a
2 m CMOS / 5V
2o Orden, 3bits
3.2
[Rabi96]
15
50
5.4
Cascada 2-1
3.3
[Yin93a]
15.7
320
65
1.2m CMOS / 5V
Cascada 2-1
3.9
[Pelu96]
12
0.1
2 Orden
4.1
[Bran91a]
16
50
13.8
1m CMOS /5V
2o Orden
4.3
[Bran91b]
12
2100
41
1m CMOS / 5V
4.8
[Mats94]
9.4
384
1.56
0.5m CMOS / 1V
RC, swing-suppression
6.0
[Will94]
17
50
47
1m CMOS /5V
Cascada 2-1
7.2
[Dedi94]
14.7
200
40
7.7
[Gril96]
15.3
2 Orden
8.1
[Bair95]
13.7
500
58
1.2m CMOS / 5V
4o Orden, 4bits
9.0
a. Aunque este convertidor incluye el filtro digital, el consumo de potencia corresponde nicamente al modulador.
Los resultados de esta Tesis se demuestran mediante la implementacin monoltica de tres moduladores en tecnonologas CMOS. Estos moduladores, junto a
las metodologas que han posibilitado su implementacin, han sido desarrollado en
32
el marco de dos proyectos CEE-ESPRIT: #5056 (AD2000) y #8795 (AMFIS) dedicados a la investigacin bsica sobre convertidores de datos de alta resolucin en
tecnologas CMOS standard y desarrollo de metodologas de diseo (AD2000) y a su
aplicacin a proyectos industriales especficos de diversa ndole (AMFIS). En particular, dos de los moduladores que se presentan en esta Tesis estn directamente relacionados con dos de las aplicaciones industriales en AMFIS.
El modulador de segundo orden, descrito en el Captulo 4, fue diseado como
parte de un front-end para la medicin de energa en una lnea de suministro elctrico. Los resultados experimentales muestran que el prototipo tiene una resolucin
efectiva de 16.4bits para DOR = 9.6kS/s, que es ms que suficiente para los requirimientos del medidor de energa. Adems, el consumo de potencia del modulador es
de slo 1.71mW operando a 5V y a la frecuencia de reloj nominal (2.5MHz). Estas
prestaciones resultan en un FOM de 2pJ, lo cual sita a este modulador entre los
primeros de la Tabla 1.4, tan slo superado por dos moduladores muy recientes, posteriores a los prototipos que se presentan en esta Tesis, que operan con baja tensin
de polarizacin [Send97][Zwan97].
El modulador de cuarto orden con cuantizacin multibit descrito en el
Captulo 6 fue diseado para un sistema ADSL de comunicacin de alta velocidad
sobre cable de cobre [ZCha95] que precisa 12bits de resolucin efectiva a 2.2MS/s.
El uso de una arquitectura de alto orden en cascada 2-1-1 y cuantizacin dual de un
bit y 3bits ha permitido reducir la razn de sobremuestreo a tan slo 16 (35.7MHz de
frecuencia de muestreo). Aunque el prototipo fue diseado para obtener 13bits a
2.2MS/s, las imperfeciones del set-up de test no han permitido medir ms de
12bits, debido principalmente a la presencia de ruido de conmutacin en la lneas
analgicas. Sin embargo, dicha resolucin (13bits) se obtiene cuando la frecuencia
de reloj se baja hasta 22MHz ya que entonces el ruido de conmutacin no es limitante. Tomando como buena, pues, la resolucin de 13bits, el consumo de potencia
del modulador (55mW) resulta en un FOM de 3.1pJ; esto es, 1.7pJ menor que el
modulador, similar en cuanto a prestaciones, en [Bran91b] .
Por ltimo, el modulador de cuarto orden descrito en el Captulo 5 fue diseado en el seno del Projecto AD2000. Las especificaciones iniciales 17bits a 40kS/s
fueron cubiertas con una arquitectura de cuarto orden en cascada 2-2, cuyo diseo,
con el fin de evaluar la adecuacin de los modelos y metodologias desarrollados, se
realiz de modo que la resolucin que caba esperar era exactamente la especificada.
Los resultados experimentales muestran un resolucin efectiva de 16.7bits a 40kS/s
con un consumo de potencia de 10mW (a 5V y 5.12MHz de frecuencia de muestreo).
Estas prestaciones se traducen en un FOM de 2.3pJ, tan slo 0.5pJ mayor que el del
modulador, similar en prestaciones, en [Zwan97], reportado con posterioridad.
Resumen
33
En la Fig. 1.16 se sita a estos tres moduladores en los planos resolucin-frecuencia, Fig. 1.16(a), y consumo-frecuencia, Fig. 1.16(b), junto a los restantes moduladores de la Tabla 1.2. Respecto al primero, es destacable la posicin del
modulador en cascada 2-1-1 multi-bit para ADSL, pues se trata del modulador
con mayor razn de salida digital (2.2MS/s) reportado hasta ahora. Por otro lado,
obsrvese que los tres moduladores aparecen en el plano consumo-frecuencia por
debajo de la recta de mejor ajuste correspondiente a los moduladores SC CMOS
con 5V de polarizacin de la Tabla 1.2.
1.5 Resumen
En este Captulo se han introducido las tcnicas de modulacin para la conversin A/D y los conceptos bsicos relacionados: sobremuestreo, ruido de cuantizacin, relacin seal-ruido, rango dinmico, resolucin equivalente, etc. En este
contexto, al igual que en el resto de esta Tesis, se ha prestado especial inters al modulador, puesto que es en este bloque donde se generan los mecanismos de error que,
en mayor medida, degradan las prestaciones del convertidor.
En particular, este Captulo se ha centrado en el anlisis de uno de los mecanismos de error presentes en cualquier arquitectura de modulador : el ruido de cuantizacin. La incidencia de este error, que podramos llamar ideal, puesto que es
inherente al proceso de cuantizacin, es atenuada en los moduladores mediante el
uso combinado de la tcnica de sobremuestreo y la tcnica de noise shaping. Esta
ltima permite filtrar el ruido de cuantizacin de forma que la mayor parte de su
potencia queda fuera de la banda de la seal. El filtrado es tanto ms eficiente cuanto
mayor sea la frecuencia de muestreo en comparacin con la frecuencia de Nyquist de
la seal (razn de sobremuestreo) o cuanto mayor sea el orden del modulador.
Desde este punto de vista, se han analizado las arquitecturas bsicas de moduladores : de primer orden y de segundo orden. Adems, se han resumido las caracterstica de otras arquitecturas de moduladores ms complejas: moduladores de
alto orden de lazo nico e interpolativos, moduladores en cascada y moduladores con
cuantizacin multibit, alguna de las cuales sern utilizadas en el diseo de moduladores en esta Tesis. Para todas ellas se han resaltado las ventajas e inconvenientes en
funcin de su rango dinmico, tendencia a la inestabilidad, generacin de patrones
de ruido y sensibilidad a no idealidades de la circuitera.
34
Resumen
35
22
20
18
16
(BiCMOS)
14
12
(a)
10
10 2
103
104
105
106
Razn de salida digital (muestras/s)
107
10-4
Ajuste de los moduladores CMOS
con 5V de tensin de polarizacin
10-5
(BiCMOS)
-6
10
10-7
10-8
(b)
10-9 2
10
(baja tensin)
(modo intensidad)
Moduladores en esta Tesis
10 3
10 4
105
106
Razon de salida digital (muestras/s)
107
Figura 1.16: Moduladores presentados en esta Tesis en los planos (a) ResolucinDOR y (b) Potencia (W) / 2bits- DOR.
36
Se ha realizado una recopilacin de los circuitos integrados reportados en la bibliografa que definen el Estado del Arte del diseo de moduladores . La eficacia
de estos diseos se ha evaluado mediante una figura de mrito (FOM) que combina
la resolucin y la razn de salida digital con el consumo de potencia. Los resultados
muestran que slo se han reportado 14 moduladores con un FOM menor que 10pJ en
el periodo 1991-1997.
Por ltimo, los moduladores diseados en esta Tesis se han ubicado en el
Estado del Arte. Con ello se ha comprobado que las tcnicas de optimizacin
empleadas para su diseo generan moduladores con bajo FOM; esto es, con consumos de potencia ajustados en funcin de las especificaciones.