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Sistemas Digitales
Guía No. 1: FPGA Cyclone II
Quartus II Edición Web 13.0 sp1. La Edición Web es una versión gratuita de Quartus II
que puede ser descargada o enviada gratuitamente por correo. Esta edición permite la
compilación y la programación de un número limitado de dispositivos Altera.
La familia de FPGAs de bajo coste Cyclone, está soportada por esta edición, por lo que los
pequeños desarrolladores no tendrán problemas por el coste del desarrollo de software.
Se requiere un registro de licencia para utilizar la Edición Web de Quartus II, la cual es
gratuita y puede ser renovada ilimitadamente.
Quartus II necesita una herramienta aparte que no vienen incluida dentro del programa
principal, que sirve como interfaz entre el software y el equipo programador, su nombre es
Quartus programmer y debe estar acorde con la versión del software, esta herramienta
permite la configuración del programador y es la encargada de la descarga de datos hacia el
dispositivo físico.
Familia Cyclone II
Los dispositivos Cyclone II EP2C5T144C6 son de bajo costo y alto rendimiento basados
en la arquitectura Cyclone II de Altera. Son fabricados con tecnología avanzada CMOS,
operan con 3.3v. Proveen entre 4000 a 20000 compuertas utilizables y contadores de
velocidad superiores a 227.3 MHz. Son totalmente compatibles con lógica TTL.
Luego de dar clic a la versión, se llegara a la siguiente página en donde se debe descargar
los archivos marcados.
Todo esto tendrá un peso de 1.6 GB aproximado, pero se debe tener libre por lo menos 6
GB en disco duro para completar la instalación de forma satisfactoria.
Los siguientes pasos son similares a cualquier programa en Windows, aceptar los términos
y condiciones, seleccionar la carpeta de instalación (recordar esta dirección ya que
posteriormente se utiliza).
Figura No. 6: Términos y condiciones.
Figura No. 7: Carpeta de instalación.
Una vez finalizada la instalación el programa estará listo para ser utilizado, en la ventana
principal se despliega un asistente para la ejecución de un nuevo proyecto, esa sección será
descrita posteriormente.
Figura. 8: Pantalla inicial Quartus II.
La instalación del Quartus Programmer es posterior y sigue la misma lógica del programa
anterior, Quartus Programmer es una extensión de la suite por lo tanto es un programa
independiente, si se necesitara solo el programador perfectamente se podría instalar sin
necesidad de instalar toda la suite, y para programar los dispositivos solamente se
necesitarían los archivos .pof generados por el compilador previamente.
Figura No. 9: Pantalla inicial del Quartus Programmer.
Cambiar `pr cyclone II CPLD. Como se había mencionado los CPLD disponibles son de
la familia MAX 3000 con un empaquetamiento tipo TQFP (Thin Quad Flat Package),
correspondiente a un montaje superficial, ya que los dispositivos son de uso académico lo
ideal era crear una base estándar, siguiendo esta idea se tomó el estándar DIL40 (Dual in
Line, 40 pines) y se reconfiguro el nuevo pinout del dispositivo, el cual quedo de la
siguiente manera:
No. de Pin Descripcion No. de Pin Descripcion 1 TDI, I/O expandible 21, 22, 23 General
I/O 2, 3 General I/O 24 VCC 4 GND 25 InputOE2 5, 6 General I/O 26 InputGCLK2 7
TMS, I/O expandible 27 InputOE1 8 General I/O 28 InputGCLK1 9 VCC (3.3 V) 29, 30,
31 General I/O 10 General I/O 32 TDO, I/O expandible 11, 12, 13, 14 General I/O 33
General I/O 15 VCC 34 VCC 16, 17, 18, 19, 20 General I/O 35,36 General I/O 37 TMS,
I/O expandible 38, 40 General I/O 39 GND
Tabla No. 1: Pin Out Base estándar. Colocar una tabla de cyclone II
3. Se abrirá un asistente, en el cual hay que completar 5 pasos para la configuración del
proyecto.
4. En el paso número 1 se asignara la carpeta en donde se guarden los archivos creados por
el proyecto, así como también el nombre del mismo, la carpeta puede tener cualquier
ubicación y el nombre del proyecto puede ser cualquiera.
Figura No. 11: pagina 1 creación del proyecto
A la siguiente ventana OK
Si observas con
detenimiento veras los
terminales Vcc y GND
en cada uno de los
extremos de los pines
dispuestos como I/O
(Input/Output).
1. Realizar el código VHDL para las compuertas: AND, NAND, OR, NOR, EXOR,
EXNOR y NOT, simular en VHDL.
1.1 Explicar paso a paso como es el proceso de instalación del software VHDL usado.
1.2 Realizar el código VHDL para el problema que se le plantea: Un circuito lógico tiene
cuatro entradas A, B, C y D. Determine las ecuaciones lógicas para el circuito, si la salida
será alta solo cuando un número impar de entradas sean altas. Trace un diagrama de
circuito con las compuertas que desee
1.3 Una alarma contra robos esa diseñada de modo que percibe cuatro líneas de señal de
entrada. La línea A es del interruptor secreto de control, la línea B es del sensor de presión
bajo una caja fuerte en un gabinete cerrado, la línea C es de un reloj alimentado por baterías
y la línea D está conectada a un interruptor en la puerta cerrada del gabinete. Las siguientes
condiciones producen un voltaje de 1 lógico en cada línea. A: El interruptor de control está
cerrado. B: La caja está en su posición normal en el gabinete. C: El reloj marca entre las
1000 y las 1400 horas. D: la puerta del gabinete está cerrada. Escriba en código VHDL la
expresión que active la alarma cuando la caja se mueve y el interruptor de control está
cerrado, o cuando el gabinete se abre después de las horas hábiles, o el gabinete está abierto
con el interruptor de control abierto. Trace un Diagrama de circuito.
Descripción: Se trata de un automóvil con tres sensores, uno al frente y dos a los costados.
Al arrancar, se dirige hacia adelante y si encuentra un obstáculo, gira a uno de los costados,
esquivándolo. La posición de los sensores se muestra en la siguiente figura.
Para girar a los lados, se hace que las llantas giren en distintas direcciones, por ejemplo
para girar a la izquierda, las llantas “X” rotaran hacia atrás mientras las llantas “Y” hacia
adelante. Para hacer que el par de llantas “X” giren hacia adelante se deberá poner en una
variable de control llamada “X” el bit 0, para que giren hacia atrás X=1, igual para el par de
llantas “Y”, con su respectiva variable de control “Y”, la lógica de control de las llantas es
la siguiente.
2. Preguntas de Investigación.
3. Acerca de la tarea:
3.1 Un reporte impreso 70%
3.1.1 Contenido del reporte
Portada. 5%
Objetivos (General y específicos). 5%
Introducción (máx. 1 página). 5%
Marco teórico (máx. 5 páginas). 5%
Obtención del software de simulación VHDL (dirección de descarga) y pasos de
instalación. 10%
Desarrollo de los circuitos:
o Descripción de los pasos seguidos para la solución. 10%
o Código VHDL. 10%
o Gráficos obtenidos para cada circuito (3 a 5 imágenes por circuito). 10%
o Observaciones. 5 %
Respuesta a las preguntas de investigación. 10%
Conclusiones (máx. 1 página). 20%
Bibliografía. 5% 3.2 Un CD 30% 3.2.1 Contenido del CD.
Software utilizado. 20%
Reporte en formato PDF y WORD. 15%
Códigos utilizados (*.vhd) y todos los que genera el proceso de compilación y ejecución.
40%
Imágenes de los resultados. 25%
NOTA: El reporte se entregara en un sobre manila rotulado con los nombres y carnet,
dentro deberá ir el CD rotulado de la misma forma y el nombre del CD tendrá los carnet. El
contenido del CD deberá ir ordenado, con carpetas individuales para cada ítem mencionado
ejemplo: IMÁGENES, CIRCUITO1, etc.
Bibliografía:
VHDL Lenguaje para descripción y modelado de circuitos, Fernando Pardo Carpio,
Universidad de Valencia 1997.
https://www.youtube.com/watch?v=00PcyQRHArY
DIGLENSY SAC Primera Empresa del Perú Dedicada al Desarrollo Electrónico, tutorial
VHDL, http://www.diglensy.com/
Análisis y diseño de circuitos lógicos digitales, Víctor Nelson, 1ª Ed.